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積體電路技術
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99年 - 99 高等考試_二級_電子工程:積體電路技術#46302
> 申論題
題組內容
三、如何降低積體電路的功耗已成為相當重要的議題,尤其在可攜式電子產品的應用上。 在積體電路製造上可提供雙電壓的製程技術,滿足低電壓低功耗的電路設計需求。
⑴如何在製程參數設定上提供雙電壓的設計方案?(10 分)
相關申論題
⑵當提供電壓(Supply Voltage VDD)降低時是否造成電晶體特性的改變?如何在製 程或電路設計上降低漏電流的效應?(14 分)
#157651
⑴試說明邏輯製程和 DRAM 製程的主要差異。(8 分)
#157652
⑵一般 DRAM 的製程主要採溝槽式(Trench)和堆疊式(Stack),說明此兩方案 的製造技術以及在高儲存容量下的優劣分析。(10 分)
#157653
⑶欲實現一個具有高記憶容量的高速特殊應用積體電路(High-Speed ASIC),試分 析分別在邏輯製程和 DRAM 製程實現的優缺點。(8 分)
#157654
⑴ cytokine
#157655
⑵ nucleosome
#157656
⑶ succession
#157657
⑷ blood-brain barrier
#157658
⑸ bottleneck effect
#157659
⑹ commensalism
#157660
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