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研究所、轉學考(插大)、學士後-計算機概論
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110年 - 110台灣聯合大學系統_碩士班招生考試_電機類:計算機系統(計算機組織)#104945
> 申論題
題組內容
8.[13%]
(b) [3%] Assume 185 and 169 are signed 8-bit decimal integers store in two's complement format. Calculate 185+169. The result should be written in decimal.
相關申論題
(c) [3%] What decimal number does the bit pattern Ox0E000000 represent if it is a floating point number? Use the IEEE 754 standard.
#445011
(d) [4%] Calculate the binary number (1.1100)*(-0.1101) step by step. You should use guard, round and sticky bit in rounding step. The result should store in IEEE 754 with 5 bits mantissa.
#445012
(a) [3%] What is the block size (in words) of each case?
#445013
(b) [3%] For the total of two cases, how many entries does the cache have??
#445014
Starting from power on, the following byte-addressed cache references are recorded.(c) [3%] For Case I, how many blocks are replaced?
#445015
(d) [3%] For Case I, what is the hit ratio?
#445016
(e) [4%] For Case I as the final state of the cache, how many valid entries in this cache? Show the index for each valid entry. Case I
#445017
(a) [3%] Assume the miss rate of an instruction cache is 2% and the miss rate of the data cache is 4%, If a processor has a CPI of 2 without any memory stalls and the miss penalty is 200 cycles for all misses. Assume the frequency of all loads and stores is 36%. Determine how much faster a processor would run with a perfect cache that never missed.
#445018
(b) [3%] If the processor has a base CPI of 1, and clock rate of 4 GHz. Assume the memory access time is 100 ns, including al the miss handling. Suppose the miss rate per instruction at the primary cache is 3%. Now we add a secondary data cache that has a 5 ns access time for either a hit or a miss, and is large enough to reduce the miss rate to main memory to 0.5%. What is the total CPI of this two-level cache?
#445019
(a) [3%] For a single-level page table, how much physical memory is needed for storing the page table?
#445020
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