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統測◆04電機與電子群資電類◆(二)數位邏輯、數位邏輯實習、電子學實習、計算機概論(110以前)
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106年 - 106 四技二專統測_電機與電子群資電類_專業科目(二):數位邏輯、數位邏輯實習、電子學實習、計算機概論#61688
> 試題詳解
6. 有一個邏輯電路可將頻率為 256 Hz 的輸入方波信號除頻為 1 Hz,其結構主要為使用 D 型 正反器的 “ 非同步計數器 ”,其中每個D 型正反器的傳遞延遲時間為 10 ns,從整體電路反應 時間來看,此除頻電路正常操作的最高工作頻率為何?
(A) 80MHz
(B) 12.5MHz
(C) 2.56MHz
(D) 0.390625MHz
答案:
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統計:
A(7), B(50), C(13), D(5), E(0) #1584293
詳解 (共 1 筆)
Chin Lian Chen
B1 · 2018/07/15
#2917240
256=2^8D型正反器為頻率÷2 因此...
(共 77 字,隱藏中)
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7. 如圖 ( 三 ) 電路圖中,若電路狀態的呈現以 Q4Q3Q2Q1Q0 表示,請問何種初始狀態下,電路 經過 7 個時脈週期後會呈現 10001 狀態? (A) 11011 (B) 10101 (C) 00000 (D) 11111圖(三)
#1584294
8. 小明必須設計一個邏輯電路,目標是將時脈信號的頻率從 10 MHz ( f in )除頻為 2 MHz ( f out ) 。 圖 ( 四) 所示為小明應用非同步計數器所設計的除頻器電路,其中,Q2為最高位元 ( MSB) , 而Q0為最低位元( LSB ),但NAND 閘的輸入信號 A2A1A0與正反器輸出信號Q2 Q1 Q0有尚未 完成的連接關係。假設所有正反器的PR= 1,試問此電路中A2A1A0與Q2Q1 Q0之連接關係式為 何? (A) (B) (C) (D)圖(四)
#1584295
9. 如圖 ( 五 ) 所示之計數器,其時脈 CLOCK 輸入頻率為 60 Hz 的方波 ( 準位 ' 1 ' 的時間佔週期50 % ) ,請問 QA 的輸出信號頻率為何?在每個週期輸出信號中,準位 ' 1 ' 的時間所佔之百分比 又為何? (A) 頻率為20Hz,準位為' 1 '的時間佔一個 週期的25% (B) 頻率為15Hz,準位為' 1 '的時間佔一個 週期的50 % (C) 頻率為15Hz,準位為' 1 '的時間佔一個 週期的25% (D) 頻率為30Hz,準位為' 1 '的時間佔一個 週期的66% 圖(五)
#1584296
10. 如圖(六)所示,假設圖內兩個邏輯閘的延遲時間皆為Td,請問下列敘述何者正確? (A)當A輸入一個由高準位轉為低準位的脈波,則Y會輸出一個寬度為Td的高準位脈波,而後 維持低準位 (B) 當 A 輸入一個由低準位轉為高準位的脈波,則 Y 輸出一個寬度為 Td 的高準位脈波,而後 維持低準位 (C) 當 A 輸入一個由高準位轉為低準位的脈波,則 Y 在延遲 2 個 Td 時間後,產生一個脈波 上升正緣,並維持寬度為Td的高準位脈波,而後維持低準位 (D) 當 A 輸入一個由低準位轉為高準位的脈波,則 Y 在延遲 2 個 Td 時間後,產生一個脈波 上升正緣,並維持寬度為Td的高準位脈波,而後維持低準位 圖(六)
#1584297
第二部份:數位邏輯實習 (第 11 至 20 題,每題 2.5 分,共 25 分 ) 11. 針對儀器設備使用不當所引起的電器火災,應如何妥善處置? (A) 切斷電源後,必須使用特種金屬化學乾粉撲滅 (B) 切斷電源前,必須使用泡沫滅火器 (C) 切斷電源前,可使用泡沫滅火器 (D) 切斷電源後,才可使用水撲滅
#1584298
12. 關於常用的實驗儀器特性與使用方法之敘述,下列何者錯誤? (A) 三用電表ACV檔所量測得到的電壓值為均方根值 (B) 示波器可以提供任意頻率的時脈信號 (C) 邏輯探測棒是用來測試數位電路中某一測試點的邏輯準位 (D)若函數波形產生器的信號峰值衰減鈕選擇– 40 dB時,則輸出信號的振幅衰減為原有振幅 的1/ 100
#1584299
13. 在“只使用一顆邏輯IC”的條件下,下列何者可以實現兩個獨立的雙輸入互斥或閘? (A) 一顆內含6個反閘的7404 (B) 一顆內含4個或閘的7432 (C) 一顆內含4個反互斥或閘的74266 (D) 一顆內含4個反或閘的7402
#1584300
14. 如圖 ( 七 ) 中的環狀計數器,一開始由 RST 信號重置計數器,重置之後 RST 維持低準位, 接到 B 之 D 型正反器輸出皆為 0。若 X 表示為 7485 的 A 輸入,同時 X3為最高位元,且 A3與 B3亦為最高位元,請問下列敘述何者正確? (A) 若X=9,經過五個時脈週期後,7485的輸入B=7 (B) 若X=5,經過四個時脈週期後,7485的輸入B=7 (C) 若X= 9,經過四個時脈週期後,7485的輸入B=14 (D) 若X=5,經過四個時脈週期後,7485的輸入B=14 圖(七)
#1584301
15. 4 位元的加法器 IC 74LS83,其輸入接腳有 “ 加數 ” 與 “ 被加數 ” 外,還有 “ 前級進位 ” 位元; 輸出接腳有“和”與“進位”位元,請問一顆74LS83全部的接腳數目為何? (A) 20 (B) 18 (C) 16 (D) 14
#1584302
16. 圖 ( 八 ) 所示為利用四位元並列加法器所設計的邏輯電路,其中,輸入信號為 A4 A3 A2 A1、 X4 X3 X2 X1 和前級進位輸入 C0,相加後產生的輸出信號為 S4 S3 S2 S1 與進位輸出 C1。試問當 C0 = 1時 ,且輸入信號 A4 A3 A2 A1 = 0100 和 X4 X3 X2 X1 = 0111 , 則進位輸出 C1 與輸出信號 S4 S3 S2 S1為何? (A) C1=0且S4 S3 S2 S1=1101 (B) C1=1且S4 S3 S2 S1=1101 (C) C1=0且S4 S3 S2 S1 =1011 (D) C1=1且S4 S3 S2 S1=1011 圖(八)
#1584303
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